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- cache optimization
- dynamic scheduling
- store conditional
- sql
- pipelined
- load linked
- nonblocking cache
- dependence
- atomic exchange
- pipline hazards
- structural hazard
- mesi
- Cache
- speculative execution
- way prediction
- relational model
- ISA
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- register renaming
- sequential consistency
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- transactional memory
- 관계형 모델
- branch prediction
- pipelined cache
- directory based coherence protocol
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목록cache coherence (2)
공대생의 공부흔적

참고: Computer Architecture: A Quantitative Approach (5th edition) - 5.4.지난 글에 이어, 캐시 일관성에 대한 추가적인 주제들을 다룰 것이다.목차캐시 일관성 미스다층 캐시디렉토리 기반 프로토콜1. 캐시 일관성 미스일반적으로 캐시 미스에는 cold, capacity, conflict 세 가지의 미스가 존재한다.하지만 invalidation 기반 멀티프로세서에만 있는 새로운 캐시 미스의 종류가 존재한다. 예를 들면 다음과 같다.P1 read address A (S state)P2 write to address A (P1은 I state, P2는 M state)P1 read address A → 이때 invalidation으로 인해 캐시 미스가 발생한다.이..

참고: Computer Architecture: A Quantitative Approach (5th edition) - 5.2.이번 글에서는 캐시 일관성에 대한 개념 소개 및 3가지 프로토콜에 대해서 다루고자 한다.목차캐시 일관성 문제MSI 프로토콜MESI 프로토콜MOESI 프로토콜1. 캐시 일관성 문제소프트웨어는 캐시 일관성에 대해 신경쓰지 않는다. 하드웨어는 여러 캐시나 메인 메모리 내의 같은 주소에 대해 값들을 유지해야 하며, 하나의 공유 메모리 공간에 대한 추상화를 지원해야 한다. → 캐시 일관성이란, 공유 메모리 멀티프로세서에서의 통신 메커니즘을 뜻한다.프로세서는 데이터를 공유하기 위해 로컬 캐시를 읽거나/에 쓴다.캐시 일관성은 여러 프로세서에 공유되는 데이터 값을 제공하는 데 그 책임이 있다...